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关于模拟电路设计中噪声分析的11个误区(一)

噪声是模拟电路设计的一个核心问题,它会直接影响能从测量中提取的信息量,以及获得所需信息的经济成本。遗憾的是,关于噪声有许多混淆和误导信息,可能导致性能不佳、高成本的过度设计或资源使用效率低下。本文阐述关于模拟设计中噪声分析的11个由来已久的误区。1.降低电路中的电阻值总是能改善噪声性能噪声电压随着电阻值提高而增加,二者之间的关系已广为人知,可以用约翰逊噪声等式来描述:erms = √4kTRB,其中erms为均方根电压噪声,k为玻尔兹曼常数,T为温度(单位为K),R为电阻值,B为带宽。这让许多工程师得出结论:为了降低噪声,应当降低电阻值。虽然这常常是正确的,但不应就此认定它是普遍真理,因为在有些例子中,较大的电阻反而能够改善噪声性能。举例来说,在大多数情况下,测量电流的方法是让它通过一个电阻,然后测量所得到的电压。根据欧姆定律V = I × R,产生的电压与电阻值成正比,但正如上式所示,电阻的约翰逊噪声与......阅读全文

关于模拟电路设计中噪声分析的11个误区(二)

5.直流耦合电路中必须始终考虑1/f噪声1/f噪声对超低频率电路是一大威胁,因为许多常用噪声抑制技术,像低通滤波、均值和长时间积分等,对它都无效。然而,许多直流电路的噪声是以白噪声源为主,1/f噪声对总噪声无贡献,因而不用计算1/f噪声。为了弄清这种效应,考虑一个放大器,其1/f噪声转折频率